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芯片验证策略六部曲

时间:2021-02-21 00:44
本文摘要:检查策略篇之一:设计流程通过芯片产品开发流程图,在描述中将研发流程分为两条线:芯片功能细分是不同人员的任务分配是不同人员在硅前的不同阶段构建和测试芯片的模块功能从另一个角度来看,芯片的开发是一个大幅度减少抽象水平的过程,从最初的抽象自然语言描述到硬件的HDL语言描述,到最后的网关表。我们已经说明了RTL设计和网关表之后,这里必须引入抽象级别比现在高的描述TLM (事务级别模型)。 TLM一般不会被用作初期构建硬件的不道德,重点是其功能描述,不需要在意时间序列。

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检查策略篇之一:设计流程通过芯片产品开发流程图,在描述中将研发流程分为两条线:芯片功能细分是不同人员的任务分配是不同人员在硅前的不同阶段构建和测试芯片的模块功能从另一个角度来看,芯片的开发是一个大幅度减少抽象水平的过程,从最初的抽象自然语言描述到硬件的HDL语言描述,到最后的网关表。我们已经说明了RTL设计和网关表之后,这里必须引入抽象级别比现在高的描述TLM (事务级别模型)。

TLM一般不会被用作初期构建硬件的不道德,重点是其功能描述,不需要在意时间序列。另外,各个TLM模型不会合并到一个系统中,用于评估整个系统的性能和模块之间的交互。

另外,TLM模型在初期的设计和检查中,如果足够正确的话,也可以代替检查员的参考模型。一方面取得可为硬件设计参照的设计(从系统描述以外),另一方面加快检查(需要重新构筑参照模型。另外,TLM模型充分准确地表达硬件描述)。

TLM模型的市场需求和ESL研究开发初期的芯片研究开发模式遵循从系统结构设计到芯片设计生产、上层软件开发的再运行。但是随着产品开发的压力,另一方面系统人员、硬件人员和软件人员必须保持丰富的工作量。另外,对于芯片项目来说,硬件人员和软件人员期待着尽可能同时开展开发。

这怎么可能一起听到? 但是,芯片还没有生产,没有开发的主板是如何构建软件的呢? 在此,我们的系统构成人员不要早期构筑低抽象化水平的系统,同时该系统必须维持该基本功能和各模块的模块交换信息,通过使功能描述成为可运营的系统, 硬件人员和软件人员早期利用该系统为硬件参考这样的简单系统制作模型,可以阶段性开发多个过程分支的方式称为ESL (ESL )开发传统的系统设计过程传统的按系统设置过程是以瀑布形式开发的,该顺序开发的方式不存在明确的边界:时间边界:在不同的开发子过程之间持续执行顺序,为了延长整体的项目发布时间。的组织边界:不同研发组之间的通信计划完成前一个过程,开始后一个过程,还引入了额外的通信成本。由于ESL系统设计过程模糊或融合这个边界,ESL研究开发过程通过创建虚拟世界原型(virtualprototype )或TLM模型,对参加系统研究开发的整个集团进行阶段性研究开发之所以有这个魔力,是因为TLM模型依然不能用于硬件开发和软件开发的抽象化描述,是更早期开发的软件模型。

因此,在ESL的研究开发帮助下,更好的自我开发过程比根据系统设计一起开展研究开发更快,从整体上看,这种方式有助于延长芯片开发的时间。除此之外,有在前期产品定义阶段比较能分析的模型,有助于早期检查产品的功能、性是否符合客户的拒绝,另外,还能降低装备性能的风险,降低过度设计的成本。为什么呢? 早期定义产品时,市场部不收集客户的产品特性,而是由系统框架负责人定义芯片结构。

这中间不存在几个问题。例如,系统框架负责人不能知道局部功能,不能知道所有用例都列出了功能是否一致,对于性能测试也有一些 此时,TLM模型可以帮助构建在系统级完成的模型,集成虚拟世界系统,并估计系统的性能。这对系统框架负责人来说没有信心得到合理的结构配置。因此,因为可以早期进行性能评价(而且很慢,再次发生在芯片结构的定义阶段),所以框架负责人可以及时进行资源调整,满足用户的市场需求。

否则,芯片可能会有较低的缺陷率,但如果其继续运行速度太慢,功耗太低,依然无法响应客户的拒绝。过度设计的结构和在袜子上折钻头一样,但不合适。

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客户的报价放在那里越多,你的设计就越过剩,不仅著成本迅速增加,交通事故也意味着更高的复杂性和风险。ESL和TLM拒绝系统模型需要一种语言。

机翼的多个抽象级展开模型描述。标准对外开放语言有效的建模性能和调试模块反对主流的建模工具本身包括在TLM事务级别传输的模块,这是即将讨论的SystemC。

SystemC说明SystemC是支持TLM模型开发的语言。严格来说,本身不是语言,而是在c上创建的类库。SystemC语言可以用于描述系统级硬件不道德,但这完全与其他语言不一致。SystemC从2006年开始被IEEE收益IEEE1666标准,本身也容易自学,为了让有C /Java基础和硬件设计概念的人一起使用,可以不花费太多自学成本。

因为SystemC语言不能说明本章的重点,所以省略更好的语言特性的说明。语言的抽象化水平在比较不同的硬件领域使用的建模语言各有适当的抽象化水平,右图表示各语言擅长的抽象化水平领域。

从左到右,VHDL和Verilog主要用于RTL建模和数字电路的集成,也用于初始构建一些检查平台。SystemVerilog/Vera/e是为了实现功能检查语言,也包括这些随机约束的最重要的特性。也可以找到SystemVerilog本身,描述硬件可以实现RTL建模和门级集成。

在此基础上,SystemC的关注点偏向于系统层面,在结构层面上可以进行更高级的抽象化层面的记述,虽然本身不能记述电路的综合网络表,但是要实现以自己为平台的上层软件开发。Matlab和其他语言用于数字信号处理,用于算法的描述和验证。从传统的系统集成观点来看,如上所述,传统的瀑布研究开发模式不能让硬件和软件人员转移到系统配置定义的初期。

对于硬件设计师和检查员来说,在系统定义完成后,需要各自翻译功能描述文档,建立可集成的模型和参照模型。软件负责人不能仅在硬件流之后可靠地开始软件开发,现在的FPGA具有比硬件慢的建模优点,但从时间段(硬件设计后期)开始速度(比软件模型) 也可以指出在理想的软件开发平台上FPGA等硬件加速器对硅后系统测试有积极的意义,但对更上层的软件层开发的合作并不那么显着。ESL系统集成的视点新的ESL系统开发方式在系统定义阶段不会创建TLM模型。

该模型的建立明显不配合系统人员、硬件设计师、检查员、软件开发者:系统人员在TLM模型集成系统上节省了追加开发不容易评价系统性能的参考模型的时间TLM构建后这具有大大加快软件开发起点TLM建模的优点,但必须考虑实施ESL系统集成过程。这不仅要他们控制SystemC的研究开发,还必须有硬件描述的基础。在此基础上,他们的工作量并不包括功能描述文档和TLM模型两者,TLM必须正确翻译成功描述文档,保证连贯性。

要从传统流程转移到ESL流程,我们可能必须做出一些让步。部署专业的虚拟世界建模团队,使系统员工能够成功地翻译文档,他们的共同产量也最终成为完全一致的参考标准。

虽然已经有了可以集成的SystemC子集和代码规格,但是至今还没有引起业界的关注。但是,当某个硬件模块无处不在或想降低建模速度时,也可以暂时用TLM模型更换原来的硬件设计。这是以系统的建模不道德维持一定,且TLM模型模块上的时机符合HDL建模的拒绝为前提的。如果TLM模型适合检查环境,则必须在TLM和检查环境之间维持标准接口(TLMinterface ),使TLM模型的插拔变得容易。

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如果TLM被用作软件开发,这将拒绝TLM尽快作为整个系统为软件开发而构建。因为作为软件开发的一部分,对某个功能模块的软件开发依然在整个芯片系统(至少在子系统上)中创建。因此,TLM模型之间也需要标准接口,可以更慢地构建系统集成。

现在我们罕见的设计过程仍然是瀑布研究开发时或类ESL研究开发。在这里,像ESL这样的研究开发意味着研究开发过程几乎不遵循上述过程,在一些地方引入了TLM建模。例如下图中,由于系统员工的技能许可,项目开发必须追加引入虚拟世界建模团队。另外,由于地区允许,虚拟世界建模团队的主要服务对象是软件开发方,与硬件设计检查团队的交流很少。

这样的ESL开发可能有很多组,但在方便的软件开发早期转移到项目时,不注意TLM模型保持系统定义和意义的一致性,在硬件和软件方面取得文本和代码参照。从图中可以看出,这种ESL的方式没有风险。

虚拟世界建模团队从系统定义到TLM模型的过程不存在于二次翻译中,因此如果不正确、不大意,基于TLM模型的软件开发,由于硬件本身也是二次翻译,所以容易重构成更可靠的硬件系统。因此,理想的合作边界应该如下图所示。虚拟世界建模首先必须保持系统定义和原义上的一致性,但硬件和软件可以将TLM模型翻译为功能描述的一致性,分别在TLM模型上展开开发。


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